數(shù)字電路與邏輯設(shè)計(jì)（第2版）

第一篇數(shù)字電路基礎(chǔ)
第1章緒論
1.1數(shù)字信號(hào)與數(shù)字電路
1.2數(shù)制
1.2.1十進(jìn)制
1.2.2二進(jìn)制
1.2.3十六進(jìn)制
1.2.4不同進(jìn)制的轉(zhuǎn)換
1.3補(bǔ)碼
1.4編碼
1.4.1十進(jìn)制代碼
1.4.2循環(huán)碼
1.4.3ASCII碼
本章小結(jié)
習(xí)題
第2章邏輯代數(shù)基礎(chǔ)
2.1邏輯運(yùn)算
2.1.1與邏輯
2.1.2或邏輯
2.1.3非邏輯
2.1.4兩種復(fù)合邏輯
2.1.5兩種特殊邏輯
2.2邏輯代數(shù)中的公式
2.2.1基本公式
2.2.2常用公式
2.2.3關(guān)于異或邏輯
2.3三種規(guī)則
2.3.1代入規(guī)則
2.3.2反演規(guī)則
2.3.3對(duì)偶規(guī)則
2.4邏輯函數(shù)的表示方法
2.4.1真值表
2.4.2函數(shù)表達(dá)式
2.4.3邏輯圖
2.4.4表示方法的相互轉(zhuǎn)換
2.5邏輯函數(shù)的標(biāo)準(zhǔn)形式
2.5.1最小項(xiàng)表達(dá)式
2.5.2最大項(xiàng)表達(dá)式
2.6邏輯函數(shù)的化簡(jiǎn)
2.7無(wú)關(guān)項(xiàng)及其應(yīng)用
本章小結(jié)
習(xí)題
第二篇數(shù)字集成電路
第3章門(mén)電路
3.1分立元件門(mén)電路
3.1.1二極管與門(mén)
3.1.2二極管或門(mén)
3.1.3三極管反相器
3.2集成門(mén)電路
3.2.1CMOS反相器
3.2.2其他邏輯門(mén)電路
3.2.3兩種特殊門(mén)電路
3.2.4CMOS傳輸門(mén)
3.3設(shè)計(jì)項(xiàng)目
本章小結(jié)
習(xí)題
第4章組合邏輯器件
4.1組合邏輯電路概述
4.2組合電路的分析與設(shè)計(jì)
4.2.1組合電路設(shè)計(jì)
4.2.2組合電路分析
4.3常用組合邏輯器件
4.3.1編碼器
4.3.2譯碼器
4.3.3數(shù)據(jù)選擇器與分配器
4.3.4加法器
4.3.5數(shù)值比較器
4.3.6奇偶校驗(yàn)器
4.4組合電路中的競(jìng)爭(zhēng)冒險(xiǎn)
4.4.1競(jìng)爭(zhēng)冒險(xiǎn)的概念
4.4.2競(jìng)爭(zhēng)冒險(xiǎn)的檢查方法
4.4.3競(jìng)爭(zhēng)冒險(xiǎn)的消除方法
4.5設(shè)計(jì)項(xiàng)目
本章小結(jié)
習(xí)題
第5章鎖存器與觸發(fā)器
5.1基本鎖存器及其描述方法
5.2門(mén)控鎖存器
5.3脈沖觸發(fā)器
5.4邊沿觸發(fā)器
5.5邏輯功能和動(dòng)作特點(diǎn)
5.6鎖存器與觸發(fā)器的動(dòng)態(tài)特性
5.6.1門(mén)控鎖存器的動(dòng)態(tài)特性
5.6.2邊沿觸發(fā)器的動(dòng)態(tài)特性
5.7設(shè)計(jì)項(xiàng)目
本章小結(jié)
習(xí)題
第6章時(shí)序邏輯器件
6.1時(shí)序邏輯電路概述
6.2時(shí)序電路的功能描述
6.2.1狀態(tài)轉(zhuǎn)換表
6.2.2狀態(tài)轉(zhuǎn)換圖
6.2.3時(shí)序圖
6.3時(shí)序電路的分析與設(shè)計(jì)
6.3.1時(shí)序電路分析
6.3.2時(shí)序電路設(shè)計(jì)
6.4寄存器與移位寄存器
6.4.1寄存器
6.4.2移位寄存器
6.5計(jì)數(shù)器
6.5.1同步計(jì)數(shù)器設(shè)計(jì)
6.5.2異步計(jì)數(shù)器分析
6.5.3任意進(jìn)制計(jì)數(shù)器
6.5.4兩種特殊計(jì)數(shù)器
6.6兩種時(shí)序單元電路
6.6.1順序脈沖發(fā)生器
6.6.2序列信號(hào)產(chǎn)生器
6.7時(shí)序電路中的競(jìng)爭(zhēng)冒險(xiǎn)
6.7.1時(shí)鐘脈沖的特性
6.7.2時(shí)序電路可靠工作的條件
6.8設(shè)計(jì)項(xiàng)目
6.8.1交通燈控制器設(shè)計(jì)
6.8.2簡(jiǎn)易頻率計(jì)設(shè)計(jì)
6.8.3數(shù)碼管控制器設(shè)計(jì)
本章小結(jié)
習(xí)題
第7章半導(dǎo)體存儲(chǔ)器
7.1ROM
7.2RAM
7.2.1靜態(tài)RAM
7.2.2動(dòng)態(tài)RAM
7.3存儲(chǔ)容量的擴(kuò)展
7.4ROM的應(yīng)用
7.4.1實(shí)現(xiàn)組合邏輯函數(shù)
7.4.2實(shí)現(xiàn)代碼轉(zhuǎn)換
7.4.3構(gòu)成函數(shù)發(fā)生器
7.5設(shè)計(jì)項(xiàng)目
7.5.1DDS信號(hào)源設(shè)計(jì)
7.5.2LED點(diǎn)陣驅(qū)動(dòng)電路設(shè)計(jì)
本章小結(jié)
習(xí)題
第8章脈沖電路
8.1描述脈沖的主要參數(shù)
8.2555定時(shí)器及應(yīng)用
8.2.1施密特電路
8.2.2單穩(wěn)態(tài)電路
8.2.3多諧振蕩器
8.3設(shè)計(jì)項(xiàng)目
本章小結(jié)
習(xí)題
第9章數(shù)模與模數(shù)轉(zhuǎn)換器
9.1數(shù)模轉(zhuǎn)換器
9.1.1權(quán)電阻網(wǎng)絡(luò)DAC
9.1.2梯形電阻網(wǎng)絡(luò)DAC
9.1.3D/A轉(zhuǎn)換器的性能指標(biāo)
9.2模數(shù)轉(zhuǎn)換器
9.2.1采樣保持電路
9.2.2量化與編碼電路
9.2.3A/D轉(zhuǎn)換器的性能指標(biāo)
9.3設(shè)計(jì)項(xiàng)目
9.3.1可編程增益放大器設(shè)計(jì)
9.3.2數(shù)控直流穩(wěn)壓電源設(shè)計(jì)
9.3.3溫度測(cè)量電路設(shè)計(jì)
本章小結(jié)
習(xí)題
第三篇數(shù)字設(shè)計(jì)新技術(shù)
第10章EDA技術(shù)基礎(chǔ)
10.1EDA技術(shù)綜述
10.1.1PLD的發(fā)展歷史
10.1.2硬件描述語(yǔ)言
10.1.3EDA工具軟件
10.2Verilog HDL
10.2.1Verilog基本結(jié)構(gòu)
10.2.23種描述方法
10.2.3層次化設(shè)計(jì)方法
10.3Verilog HDL語(yǔ)法
10.3.1基本語(yǔ)法
10.3.2數(shù)據(jù)類(lèi)型
10.3.3參數(shù)定義
10.3.4操作符
10.4測(cè)試激勵(lì)文件
本章小結(jié)
習(xí)題
第11章常用數(shù)字器件的描述
11.1組合器件的描述
11.1.1基本邏輯門(mén)
11.1.2編碼器
11.1.3譯碼器
11.1.4數(shù)據(jù)選擇器
11.1.5數(shù)值比較器
11.1.6三態(tài)緩沖器
11.1.7奇偶校驗(yàn)器
11.2時(shí)序器件的描述
11.2.1鎖存器與觸發(fā)器
11.2.2計(jì)數(shù)器
11.2.3分頻器
11.2.4雙口RAM
11.3設(shè)計(jì)項(xiàng)目
11.3.1100MHz頻率計(jì)設(shè)計(jì)
11.3.2正弦波信號(hào)源設(shè)計(jì)
11.3.3VGA彩格控制電路設(shè)計(jì)
本章小結(jié)
習(xí)題
第12章有限狀態(tài)機(jī)設(shè)計(jì)
12.1狀態(tài)機(jī)一般設(shè)計(jì)方法
12.2狀態(tài)編碼
12.3狀態(tài)機(jī)設(shè)計(jì)示例
12.4設(shè)計(jì)項(xiàng)目
12.4.1逐次漸近型A/D轉(zhuǎn)換器的設(shè)計(jì)
12.4.2交通燈控制器的設(shè)計(jì)
12.4.3等精度頻率計(jì)的設(shè)計(jì)
本章小結(jié)
習(xí)題
附錄A常用門(mén)電路邏輯符號(hào)對(duì)照表
附錄B常用元器件引腳速查
參考文獻(xiàn)