計(jì)算機(jī)組成原理在線實(shí)驗(yàn)教程：FPGA遠(yuǎn)程實(shí)驗(yàn)平臺教學(xué)與實(shí)踐

定　價(jià)：￥39.00

作　者：	柴志雷，李佩琦，吳子剛，陽文敏著
出版社：	清華大學(xué)出版社
叢編項(xiàng)：	面向“工程教育認(rèn)證”計(jì)算機(jī)系列課程規(guī)劃教材
標(biāo)　簽：	暫缺

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ISBN：	9787302537793	出版時(shí)間：	2019-12-01	包裝：	平裝
開本：	16開	頁數(shù)：	163	字?jǐn)?shù)：

內(nèi)容簡介

　　《計(jì)算機(jī)組成原理在線實(shí)驗(yàn)教程：FPGA遠(yuǎn)程實(shí)驗(yàn)平臺教學(xué)與實(shí)踐》以線上線下結(jié)合的方式，使用FPGA平臺完成數(shù)字電路及計(jì)算機(jī)組成原理實(shí)驗(yàn)，并用Python編程的方式與自己設(shè)計(jì)的硬件系統(tǒng)交互，來進(jìn)行系統(tǒng)驗(yàn)證與調(diào)試?！队?jì)算機(jī)組成原理在線實(shí)驗(yàn)教程：FPGA遠(yuǎn)程實(shí)驗(yàn)平臺教學(xué)與實(shí)踐》包含三大部分內(nèi)容：首先是實(shí)驗(yàn)所用的軟硬件工具和平臺；其次是實(shí)驗(yàn)設(shè)計(jì)方法；最后介紹實(shí)驗(yàn)內(nèi)容安排的建議?！队?jì)算機(jī)組成原理在線實(shí)驗(yàn)教程：FPGA遠(yuǎn)程實(shí)驗(yàn)平臺教學(xué)與實(shí)踐》中主要講述了PYNQ平臺與基于Python的軟硬件交互、Vivado開發(fā)工具、硬件描述語言簡介、RISC-V開源項(xiàng)目及組成原理實(shí)驗(yàn)內(nèi)容建議等?！队?jì)算機(jī)組成原理在線實(shí)驗(yàn)教程：FPGA遠(yuǎn)程實(shí)驗(yàn)平臺教學(xué)與實(shí)踐》可用作高等院校計(jì)算機(jī)類、電子信息類專業(yè)的數(shù)字電路與組成原理相關(guān)課程的實(shí)驗(yàn)教材，也可作為FPGA及嵌入式系統(tǒng)軟硬件學(xué)習(xí)的參考用書。

作者簡介

　　柴志雷，江南大學(xué)物聯(lián)網(wǎng)工程學(xué)院副教授、研究生導(dǎo)師，獲復(fù)旦大學(xué)計(jì)算機(jī)系統(tǒng)結(jié)構(gòu)方向博士學(xué)位。中國計(jì)算機(jī)學(xué)會體系結(jié)構(gòu)專業(yè)委員會及嵌入式系統(tǒng)專業(yè)委員會委員，江蘇省計(jì)算機(jī)教育專委會副主任。長期從事計(jì)算機(jī)系統(tǒng)結(jié)構(gòu)方面的教學(xué)與科研工作，研究興趣為新型計(jì)算機(jī)體系結(jié)構(gòu)、FPGA可重構(gòu)計(jì)算。承擔(dān)了國家自然科學(xué)基金、科技委創(chuàng)新特區(qū)、無錫市物聯(lián)網(wǎng)專項(xiàng)資金等科研項(xiàng)目，教育部高等學(xué)校計(jì)算機(jī)類專業(yè)教學(xué)指導(dǎo)委員會“系統(tǒng)能力培養(yǎng)”課程建設(shè)試點(diǎn)院校項(xiàng)目、Xilinx-教育部產(chǎn)學(xué)合作教學(xué)改革項(xiàng)目等教學(xué)項(xiàng)目。研究成果在FPGA、FPL、FPT、ACMTACO等FPGA會議與期刊發(fā)表學(xué)術(shù)論文30余篇，獲得授權(quán)發(fā)明專利4項(xiàng)。研究成果還在美國安富利公司香港研發(fā)中心、上海電氣集團(tuán)機(jī)器人實(shí)驗(yàn)室等單位得到應(yīng)用，獲得中國商業(yè)聯(lián)合會科技進(jìn)步一等獎(jiǎng)1項(xiàng)。

圖書目錄

第1章 PYNQ開發(fā)平臺介紹
1．1 PYNQ開發(fā)板
1．1．1 PYNQZl
1．1．2 PYNQ22
1．2 Zynq7020芯片
1．3 PYNQ框架
1．4 PYNQ平臺的使用
第2章實(shí)驗(yàn)環(huán)境的準(zhǔn)備
2．1 線下方式實(shí)驗(yàn)環(huán)境的準(zhǔn)備
2．1．1 在本機(jī)安裝Vivado軟件
2．1．2 PYNQ板卡的準(zhǔn)備
2．1．3 使用JupyterNotebook與PYNQ建立連接
2．2 線上方式實(shí)驗(yàn)環(huán)境的準(zhǔn)備
第3章基于PYNQ的組成原理實(shí)驗(yàn)流程概覽
3．1 整體開發(fā)流程介紹
3．2 Vivado開發(fā)流程概覽
3．3 基于Python的硬件交互
第4章 Vivado開發(fā)流程
4．1 創(chuàng)建工程
4．2 設(shè)計(jì)輸入
4．2．1 原理圖方式
4．2．2 Verilog/VHDL方式
4．3 仿真
4．4 綜合
4．5 引腳綁定（I/O處理）
4．5．1 物理引腳的綁定
4．5．2 與監(jiān)控模塊（PS）的連接
4．6 實(shí)現(xiàn)
4．7 TCI．使用介紹
4．8 實(shí)例演示
4．8．1 原理圖方式
4．8．2 Verilog方式
第5章基于Python的I/O交互
5．1 JupyterNotebook介紹
5．1．1 Jupyter組件
5．1．2 Notebook基礎(chǔ)
5．1．3 Notebook用戶界面
5．2 使用PYNQOverlay加載流文件
5．3 Python引腳綁定
5．4 基于Python調(diào)試組合邏輯
5．5 基于Python調(diào)試時(shí)序邏輯
5．6 實(shí)例演示
5．6．1 上傳．bit和．tcl文件
5．6．2 基于Python的I/O交互
第6章硬件描述語言簡介
6．1 “模塊”的描述
6．1．1 輸入／輸出端口說明
6．1．2 數(shù)據(jù)對象和數(shù)據(jù)類型
6．1．3 順序語句與并行語句
6．2 模塊基本用法示例
6．2．1 八位乘法器
6．2．2 譯碼器
6．2．3 八位二進(jìn)制比較器
6．2．4 JK觸發(fā)器設(shè)計(jì)
6．3 層次化設(shè)計(jì)
6．3．1 描述方式
6．3．2 層次化設(shè)計(jì)的寫法
6．4 VHDL語言基礎(chǔ)
6．4．1 標(biāo)識符
6．4．2 數(shù)據(jù)對象
6．4．3 數(shù)據(jù)類型
6．4．4 數(shù)據(jù)類型轉(zhuǎn)換
6．4．5 運(yùn)算符
6．4．6 運(yùn)算符優(yōu)先級
6．4．7 VHDL常用語法
6．5 VerilogHDL語言基礎(chǔ)
6．5．1 數(shù)據(jù)類型
6．5．2 數(shù)字表示形式
6．5．3 parameter定義常量
6．5．4 宏定義tdefine
6．5．5 運(yùn)算符及表達(dá)式
6．5．6 運(yùn)算符優(yōu)先級
6．5．7 VerilogHDL常用語法
……
第7章基于開源CPU的組成原理實(shí)驗(yàn)
第8章實(shí)驗(yàn)內(nèi)容設(shè)計(jì)
參考文獻(xiàn)