Xilinx Zynq-7000嵌入式系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)

第1章Zynq-7000 SoC設(shè)計(jì)導(dǎo)論
1．1全可編程片上系統(tǒng)基礎(chǔ)知識
1．1．1全可編程片上系統(tǒng)的演進(jìn)
1．1．2SoC與MCU和CPU的比較
1．1．3全可編程SoC誕生的背景
1．1．4可編程SoC系統(tǒng)技術(shù)特點(diǎn)
1．1．5全可編程片上系統(tǒng)中的處理器類型
1．2Zynq-7000 SoC功能和結(jié)構(gòu)
1．2．1Zynq-7000 SoC產(chǎn)品分類及資源
1．2．2Xilinx Zynq-7000 SoC功能
1．2．3Zynq-7000 SoC處理系統(tǒng)PS的構(gòu)成
1．2．4Zynq-7000 SoC可編程邏輯PL的構(gòu)成
1．2．5Zynq-7000 SoC內(nèi)的互聯(lián)結(jié)構(gòu)
1．2．6Zynq-7000 SoC的供電引腳
1．2．7Zynq-7000 SoC內(nèi)MIO到EMIO的連接
1．2．8Zynq-7000 SoC內(nèi)為PL分配的信號
1．3Zynq-7000 SoC在嵌入式系統(tǒng)中的優(yōu)勢
1．3．1使用PL實(shí)現(xiàn)軟件算法
1．3．2降低功耗
1．3．3實(shí)時減負(fù)
1．3．4可重配置計(jì)算
1．4Zynq-7000 SoC的Vivado設(shè)計(jì)流程
1．4．1Vivado的IP設(shè)計(jì)和系統(tǒng)級設(shè)計(jì)集成
1．4．2使用RTL或網(wǎng)表的設(shè)計(jì)流程
1．4．3IP子系統(tǒng)設(shè)計(jì)
1．4．4嵌入式處理器硬件設(shè)計(jì)
1．4．5使用模型和高級綜合的DSP設(shè)計(jì)
1．4．6脫離上下文的設(shè)計(jì)流程
1．4．7I/O引腳規(guī)劃和布局
1．4．8設(shè)計(jì)分析和驗(yàn)證
1．4．9器件編程和硬件驗(yàn)證
1．4．10部分可重配置
第2章AMBA協(xié)議規(guī)范
2．1AMBA規(guī)范概述
2．2AMBA APB規(guī)范
2．2．1AMBA APB寫傳輸
2．2．2AMBA APB讀傳輸
2．2．3AMBA APB錯誤響應(yīng)
2．2．4操作狀態(tài)
2．2．5AMBA3 APB信號
2．3AMBA AHB規(guī)范
2．3．1AMBA AHB結(jié)構(gòu)
2．3．2AMBA AHB操作
2．3．3AMBA AHB傳輸類型
2．3．4AMBA AHB猝發(fā)操作
2．3．5AMBA AHB傳輸控制信號
2．3．6AMBA AHB地址譯碼
2．3．7AMBA AHB從設(shè)備傳輸響應(yīng)
2．3．8AMBA AHB數(shù)據(jù)總線
2．3．9AMBA AHB傳輸仲裁
2．3．10AMBA AHB分割傳輸
2．3．11AMBA AHB復(fù)位
2．3．12關(guān)于AHB數(shù)據(jù)總線的位寬
2．3．13AMBA AHB接口設(shè)備
2．4AMBA AXI4規(guī)范
2．4．1AMBA AXI4概述
2．4．2AMBA AXI4功能
2．4．3AMBA AXI4互聯(lián)結(jié)構(gòu)
2．4．4AXI4-Lite功能
2．4．5AXI4-Stream功能
第3章Zynq-7000系統(tǒng)公共資源及特性
3．1時鐘子系統(tǒng)
3．1．1時鐘系統(tǒng)架構(gòu)
3．1．2CPU時鐘域
3．1．3時鐘編程實(shí)例
3．1．4時鐘系統(tǒng)內(nèi)生成電路結(jié)構(gòu)
3．2復(fù)位子系統(tǒng)
3．2．1復(fù)位系統(tǒng)結(jié)構(gòu)和層次
3．2．2復(fù)位流程
3．2．3復(fù)位的結(jié)果
第4章Zynq調(diào)試和測試子系統(tǒng)
4．1JTAG和DAP子系統(tǒng)
4．1．1JTAG和DAP系統(tǒng)功能
4．1．2JTAG和DAP系統(tǒng)I/O信號
4．1．3編程模型
4．1．4ARM DAP控制器
4．1．5跟蹤端口接口單元TPIU
4．1．6Xilinx TAP控制器
4．2CoreSight系統(tǒng)結(jié)構(gòu)及功能
4．2．1CoreSight結(jié)構(gòu)概述
4．2．2CoreSight系統(tǒng)功能
第5章Cortex-A9處理器及指令集
5．1應(yīng)用處理單元概述
5．1．1基本功能
5．1．2系統(tǒng)級視圖
5．2ARM處理器架構(gòu)發(fā)展
5．3Cortex-A9中央處理器結(jié)構(gòu)
5．3．1處理器模式
5．3．2寄存器
5．3．3流水線
5．3．4分支預(yù)測
5．3．5指令和數(shù)據(jù)對齊
5．3．6跟蹤和調(diào)試
5．4Cortex-A9處理器指令集
5．4．1指令集基礎(chǔ)
5．4．2數(shù)據(jù)處理操作
5．4．3存儲器指令
5．4．4分支
5．4．5飽和算術(shù)
5．4．6雜項(xiàng)指令
第6章Cortex-A9片上存儲器系統(tǒng)結(jié)構(gòu)和功能
6．1L1高速緩存
6．1．1高速緩存背景
6．1．2高速緩存的優(yōu)勢和問題
6．1．3存儲器層次
6．1．4高速緩存結(jié)構(gòu)
6．1．5緩存策略
6．1．6寫和取緩沖區(qū)
6．1．7緩存性能和命中速度
6．1．8無效和清除緩存
6．1．9一致性和統(tǒng)一性點(diǎn)
6．1．10Zynq-7000中Cortex-A9 L1高速緩存的特性
6．2存儲器順序
6．2．1普通、設(shè)備和強(qiáng)順序存儲器模型
6．2．2存儲器屬性
6．2．3存儲器屏障
6．3存儲器管理單元
6．3．1MMU功能描述
6．3．2虛擬存儲器
6．3．3轉(zhuǎn)換表
6．3．4頁表入口域的描述
6．3．5TLB構(gòu)成
6．3．6存儲器訪問順序
6．4偵聽控制單元
6．4．1地址過濾
6．4．2SCU主設(shè)備端口
6．5L2高速緩存
6．5．1互斥 L2-L1高速緩存配置
6．5．2高速緩存替換策略
6．5．3高速緩存鎖定
6．5．4使能/禁止 L2高速緩存控制器
6．5．5RAM訪問延遲控制
6．5．6保存緩沖區(qū)操作
6．5．7在Cortex-A9和L2控制器之間的優(yōu)化
6．5．8預(yù)取操作
6．5．9編程模型
6．6片上存儲器
6．6．1片上存儲器概述
6．6．2片上存儲器功能
6．7系統(tǒng)地址分配
6．7．1地址映射
6．7．2系統(tǒng)總線主設(shè)備
6．7．3I/O外設(shè)
6．7．4SMC存儲器
6．7．5SLCR寄存器
6．7．6雜項(xiàng)PS寄存器
6．7．7CPU私有總線寄存器
第7章Zynq-7000 SoC的Vivado基本設(shè)計(jì)流程
7．1創(chuàng)建新的工程
7．2使用IP集成器創(chuàng)建處理器系統(tǒng)
7．3生成頂層HDL并導(dǎo)出設(shè)計(jì)到SDK
7．4創(chuàng)建應(yīng)用測試程序
7．5設(shè)計(jì)驗(yàn)證
7．5．1驗(yàn)證前的硬件平臺準(zhǔn)備
7．5．2設(shè)計(jì)驗(yàn)證的具體實(shí)現(xiàn)
7．6SDK調(diào)試工具的使用
7．6．1打開前面的設(shè)計(jì)工程
7．6．2導(dǎo)入工程到SDK
7．6．3建立新的存儲器測試工程
7．6．4運(yùn)行存儲器測試工程
7．6．5調(diào)試存儲器測試工程
7．7SDK性能分析工具
第8章ARM GPIO的原理和控制實(shí)現(xiàn)
8．1GPIO模塊原理
8．1．1GPIO接口及功能
8．1．2GPIO編程流程
8．1．3I/O接口
8．1．4部分寄存器說明
8．1．5底層讀/寫函數(shù)說明
8．1．6GPIO的API函數(shù)說明
8．2Vivado環(huán)境下MIO讀/寫控制的實(shí)現(xiàn)
8．2．1調(diào)用底層讀/寫函數(shù)編寫GPIO應(yīng)用程序
8．2．2調(diào)用API函數(shù)編寫控制GPIO應(yīng)用程序
8．3Vivado環(huán)境下EMIO讀/寫控制的實(shí)現(xiàn)
8．3．1調(diào)用底層讀/寫函數(shù)編寫GPIO應(yīng)用程序
8．3．2調(diào)用API函數(shù)編寫控制GPIO應(yīng)用程序
第9章Cortex-A9異常與中斷原理及實(shí)現(xiàn)
9．1異常原理
9．1．1異常類型
9．1．2異常處理
9．1．3其他異常句柄
9．1．4Linux異常程序流
9．2中斷原理
9．2．1外部中斷請求
9．2．2Zynq-7000 SoC內(nèi)的中斷環(huán)境
9．2．3中斷控制器的功能
9．3Vivado環(huán)境下中斷系統(tǒng)的實(shí)現(xiàn)
9．3．1Cortex-A9處理器中斷及異常初始化流程
9．3．2Cortex-A9 GPIO控制器初始化流程
9．3．3導(dǎo)出硬件設(shè)計(jì)到SDK
9．3．4創(chuàng)建新的應(yīng)用工程
9．3．5運(yùn)行應(yīng)用工程
第10章Cortex-A9定時器原理及實(shí)現(xiàn)
10．1定時器系統(tǒng)架構(gòu)
10．1．1CPU私有定時器和看門狗定時器
10．1．2全局定時器/計(jì)數(shù)器
10．1．3系統(tǒng)看門狗定時器
10．1．4三重定時器/計(jì)數(shù)器
10．1．5I/O信號
10．2Vivado環(huán)境下定時器的控制實(shí)現(xiàn)
10．2．1打開前面的設(shè)計(jì)工程
10．2．2創(chuàng)建SDK軟件工程
10．2．3運(yùn)行軟件應(yīng)用工程
第11章Cortex-A9 DMA控制器原理及實(shí)現(xiàn)
11．1DMA控制器架構(gòu)
11．2DMA控制器功能
11．2．1考慮AXI交易的因素
11．2．2DMA管理器
11．2．3多通道數(shù)據(jù)FIFO（MFIFO）
11．2．4存儲器―存儲器交易
11．2．5PL外設(shè)AXI交易
11．2．6PL外設(shè)請求接口
11．2．7PL外設(shè)長度管理
11．2．8DMAC長度管理
11．2．9事件和中斷
11．2．10異常終止
11．2．11安全性
11．2．12IP配置選項(xiàng)
11．3DMA控制器編程指南
11．3．1啟動控制器
11．3．2執(zhí)行DMA傳輸
11．3．3中斷服務(wù)例程
11．3．4寄存器描述
11．4DMA引擎編程指南
11．4．1寫微碼編程用于AXI交易的CCRx
11．4．2存儲器到存儲器傳輸
11．4．3PL外設(shè)DMA傳輸長度管理
11．4．4使用一個事件重新啟動DMA通道
11．4．5中斷一個處理器
11．4．6指令集參考
11．5編程限制
11．6系統(tǒng)功能之控制器復(fù)位配置
11．7I/O接口
11．7．1AXI主接口
11．7．2外設(shè)請求接口
11．8Vivado環(huán)境下DMA傳輸?shù)膶?shí)現(xiàn)
11．8．1DMA控制器初始化流程
11．8．2中斷控制器初始化流程
11．8．3中斷服務(wù)句柄處理流程
11．8．4導(dǎo)出硬件設(shè)計(jì)到SDK
11．8．5創(chuàng)建新的應(yīng)用工程
11．8．6運(yùn)行軟件應(yīng)用工程
第12章Cortex-A9安全性擴(kuò)展
12．1TrustZone硬件架構(gòu)
12．1．1多核系統(tǒng)的安全性擴(kuò)展
12．1．2普通世界和安全世界的交互
12．2Zynq-7000 APU內(nèi)的TrustZone
12．2．1CPU安全過渡
12．2．2CP15寄存器訪問控制
12．2．3MMU安全性
12．2．4L1緩存安全性
12．2．5安全異常控制
12．2．6CPU調(diào)試 TrustZone訪問控制
12．2．7SCU寄存器訪問控制
12．2．8L2緩存中的TrustZone支持
第13章Cortex-A9 NEON原理及實(shí)現(xiàn)
13．1SIMD
13．2NEON架構(gòu)
13．2．1與VFP的共性
13．2．2數(shù)據(jù)類型
13．2．3NEON寄存器
13．2．4NEON指令集
13．3NEON C編譯器和匯編器
13．3．1向量化
13．3．2檢測NEON
13．4NEON優(yōu)化庫
13．5SDK工具提供的優(yōu)化選項(xiàng)
13．6使用NEON內(nèi)聯(lián)函數(shù)
13．6．1NEON數(shù)據(jù)類型
13．6．2NEON內(nèi)聯(lián)函數(shù)
13．7優(yōu)化NEON匯編器代碼
13．8提高存儲器訪問效率
13．9自動向量化實(shí)現(xiàn)
13．9．1導(dǎo)出硬件設(shè)計(jì)到SDK
13．9．2創(chuàng)建新的應(yīng)用工程
13．9．3運(yùn)行軟件應(yīng)用工程
13．10NEON匯編代碼實(shí)現(xiàn)
13．10．1導(dǎo)出硬件設(shè)計(jì)到SDK
13．10．2創(chuàng)建新的應(yīng)用工程
13．10．3運(yùn)行軟件應(yīng)用工程
第14章Cortex-A9外設(shè)模塊結(jié)構(gòu)及功能
14．1DDR存儲器控制器
14．1．1DDR存儲器控制器接口及功能
14．1．2AXI存儲器端口接口
14．1．3DDR核和交易調(diào)度器
14．1．4DDRC仲裁
14．1．5DDR控制器PHY
14．1．6DDR初始化和標(biāo)定
14．1．7糾錯碼
14．2靜態(tài)存儲器控制器
14．2．1靜態(tài)存儲器控制器接口及功能
14．2．2靜態(tài)存儲器控制器和存儲器的信號連接
14．3四-SPI Flash控制器
14．3．1四-SPI Flash控制器功能
14．3．2四-SPI Flash控制器反饋時鐘
14．3．3四-SPI Flash控制器接口
14．4SD/SDIO外設(shè)控制器
14．4．1SD/SDIO控制器功能
14．4．2SD/SDIO控制器傳輸協(xié)議
14．4．3SD/SDIO控制器接口信號連接
14．5USB主機(jī)、設(shè)備和OTG控制器
14．5．1USB控制器接口及功能
14．5．2USB主機(jī)操作模式
14．5．3USB設(shè)備操作模式
14．5．4USB OTG操作模式
14．6吉比特以太網(wǎng)控制器
14．6．1吉比特以太網(wǎng)控制器接口及功能
14．6．2吉比特以太網(wǎng)控制器接口編程向?qū)?br /> 14．6．3吉比特以太網(wǎng)控制器接口信號連接
14．7SPI控制器
14．7．1SPI控制器的接口及功能
14．7．2SPI控制器時鐘設(shè)置規(guī)則
14．8CAN控制器
14．8．1CAN控制器接口及功能
14．8．2CAN控制器操作模式
14．8．3CAN控制器消息保存
14．8．4CAN控制器接收過濾器
14．8．5CAN控制器編程模型
14．9UART控制器
14．9．1UART控制器接口及功能
14．10I2C控制器
14．10．1I2C速度控制邏輯
14．10．2I2C控制器的功能和工作模式
14．11ADC轉(zhuǎn)換器接口
14．11．1ADC轉(zhuǎn)換器接口及功能
14．11．2ADC命令格式
14．11．3供電傳感器報(bào)警
14．12PCI-E接口
第15章Zynq-7000內(nèi)的可編程邏輯資源
15．1可編程邏輯資源概述
15．2可編程邏輯資源功能
15．2．1CLB、Slice和LUT
15．2．2時鐘管理
15．2．3塊RAM
15．2．4數(shù)字信號處理-DSP Slice
15．2．5輸入/輸出
15．2．6低功耗串行收發(fā)器
15．2．7PCI-E模塊
15．2．8XADC（模擬-數(shù)字轉(zhuǎn)換器）
15．2．9配置
第16章Zynq-7000內(nèi)的互聯(lián)結(jié)構(gòu)
16．1系統(tǒng)互聯(lián)架構(gòu)
16．1．1互聯(lián)模塊及功能
16．1．2數(shù)據(jù)路徑
16．1．3時鐘域
16．1．4連接性
16．1．5AXI ID
16．1．6寄存器概述
16．2服務(wù)質(zhì)量
16．2．1基本仲裁
16．2．2高級QoS
16．2．3DDR端口仲裁
16．3AXI_HP接口
16．3．1AXI_HP接口結(jié)構(gòu)及特點(diǎn)
16．3．2接口數(shù)據(jù)寬度
16．3．3交易類型
16．3．4命令交替和重新排序
16．3．5性能優(yōu)化總結(jié)
16．4AXI_ACP接口
16．5AXI_GP接口
16．6AXI信號總結(jié)
16．7PL接口選擇
16．7．1使用通用主設(shè)備端口的Cortex-A9
16．7．2通過通用主設(shè)備的PS DMA控制器（DMAC）
16．7．3通過高性能接口的PL DMA
16．7．4通過AXI ACP的PL DMA
16．7．5通過通用AXI從（GP）的PL DMA
第17章Zynq-7000 SoC內(nèi)定制簡單AXI-Lite IP
17．1設(shè)計(jì)原理
17．2定制AXI-Lite IP
17．2．1創(chuàng)建定制IP模板
17．2．2修改定制IP設(shè)計(jì)模板
17．2．3使用IP封裝器封裝外設(shè)
17．3打開并添加IP到設(shè)計(jì)中
17．3．1打開工程和修改設(shè)置
17．3．2添加定制IP到設(shè)計(jì)
17．3．3添加xdc約束文件
17．4導(dǎo)出硬件到SDK
17．5建立和驗(yàn)證軟件應(yīng)用工程
17．5．1建立應(yīng)用工程
17．5．2下載硬件比特流文件到FPGA
17．5．3運(yùn)行應(yīng)用工程
第18章Zynq-7000 SoC內(nèi)定制復(fù)雜AXI LITE IP
18．1設(shè)計(jì)原理
18．1．1VGA IP核的設(shè)計(jì)原理
18．1．2移位寄存器IP核的設(shè)計(jì)原理
18．2定制VGA IP核
18．2．1創(chuàng)建定制VGA IP模板
18．2．2修改定制VGA IP模板
18．2．3使用IP封裝器封裝VGA IP
18．3定制移位寄存器IP核
18．3．1創(chuàng)建SHIFTER IP模板
18．3．2修改定制SHIFTER IP模板
18．3．3使用IP封裝器封裝SHIFTER IP
18．4打開并添加IP到設(shè)計(jì)中
18．4．1打開工程和修改設(shè)置
18．4．2添加定制IP到設(shè)計(jì)
18．4．3添加xdc約束文件
18．5導(dǎo)出硬件到SDK
18．6建立和驗(yàn)證軟件工程
18．6．1建立應(yīng)用工程
18．6．2下載硬件比特流文件到FPGA
18．6．3運(yùn)行應(yīng)用工程
第19章Zynq-7000 AXI HP數(shù)據(jù)傳輸原理及實(shí)現(xiàn)
19．1設(shè)計(jì)原理
19．2構(gòu)建硬件系統(tǒng)
19．2．1打開工程和修改設(shè)置
19．2．2添加并連接AXI DMA IP核
19．2．3添加并連接FIFO IP核
19．2．4連接DMA中斷到PS
19．2．5驗(yàn)證和建立設(shè)計(jì)
19．3建立和驗(yàn)證軟件工程
19．3．1導(dǎo)出硬件到SDK
19．3．2創(chuàng)建軟件應(yīng)用工程
19．3．3下載硬件比特流文件到FPGA
19．3．4運(yùn)行應(yīng)用工程
第20章Zynq-7000 ACP數(shù)據(jù)傳輸原理及實(shí)現(xiàn)
20．1設(shè)計(jì)原理
20．2打開前面的設(shè)計(jì)工程
20．3配置PS端口
20．4添加并連接IP到設(shè)計(jì)
20．4．1添加IP到設(shè)計(jì)
20．4．2系統(tǒng)連接
20．4．3分配地址空間
20．5使用SDK設(shè)計(jì)和實(shí)現(xiàn)應(yīng)用工程
20．5．1創(chuàng)建新的軟件應(yīng)用工程
20．5．2導(dǎo)入應(yīng)用程序
20．5．3下載硬件比特流文件到FPGA
20．5．4運(yùn)行應(yīng)用工程
第21章Zynq-7000軟件和硬件協(xié)同調(diào)試原理及實(shí)現(xiàn)
21．1設(shè)計(jì)目標(biāo)
21．2ILA核原理
21．2．1ILA觸發(fā)器輸入邏輯
21．2．2多觸發(fā)器端口的使用
21．2．3使用觸發(fā)器和存儲限定條件
21．2．4ILA觸發(fā)器輸出邏輯
21．2．5ILA數(shù)據(jù)捕獲邏輯
21．2．6ILA控制與狀態(tài)邏輯
21．3VIO核原理
21．4構(gòu)建協(xié)同調(diào)試硬件系統(tǒng)
21．4．1打開前面的設(shè)計(jì)工程
21．4．2添加定制IP
21．4．3添加ILA和VIO核
21．4．4標(biāo)記和分配調(diào)試網(wǎng)絡(luò)
21．5生成軟件工程
21．6S/H協(xié)同調(diào)試
第22章Zynq-7000 SoC啟動和配置原理及實(shí)現(xiàn)
22．1Zynq-7000 SoC啟動過程
22．2Zynq-7000 SoC啟動要求
22．2．1供電要求
22．2．2時鐘要求
22．2．3復(fù)位要求
22．2．4模式引腳
22．3Zynq-7000 SoC內(nèi)的BootROM
22．3．1BootROM特性
22．3．2BootROM頭部
22．3．3啟動設(shè)備
22．3．4BootROM多啟動和啟動分區(qū)查找
22．3．5調(diào)試狀態(tài)
22．3．6BootROM后狀態(tài)
22．4Zynq-7000 SoC器件配置接口
22．4．1描述功能
22．4．2器件配置流程
22．4．3配置PL
22．4．4寄存器概述
22．5生成SD卡鏡像文件并啟動
22．5．1SD卡與XC7Z020接口設(shè)計(jì)
22．5．2打開前面的設(shè)計(jì)工程
22．5．3創(chuàng)建第一級啟動引導(dǎo)
22．5．4創(chuàng)建SD卡啟動鏡像
22．5．5從SD卡啟動引導(dǎo)系統(tǒng)
22．6生成QSPI Flash鏡像并啟動
22．6．1QSPI Flash接口
22．6．2創(chuàng)建QSPI Flash鏡像
22．6．3從QSPI Flash啟動引導(dǎo)系統(tǒng)
22．7Cortex-A9雙核系統(tǒng)的配置和運(yùn)行
22．7．1構(gòu)建雙核硬件系統(tǒng)工程
22．7．2添加并互聯(lián)IP核
22．7．3導(dǎo)出硬件設(shè)計(jì)到SDK中
22．7．4設(shè)置板級包支持路徑
22．7．5建立FSBL應(yīng)用工程
22．7．6建立CPU0應(yīng)用工程
22．7．7建立CPU1板級支持包
22．7．8建立CPU1應(yīng)用工程
22．7．9創(chuàng)建SD卡鏡像文件
22．7．10雙核系統(tǒng)運(yùn)行和測試
22．7．11雙核系統(tǒng)的調(diào)試
第23章Zynq-7000 SoC內(nèi)XADC原理及實(shí)現(xiàn)
23．1ADC轉(zhuǎn)換器接口結(jié)構(gòu)
23．2ADC轉(zhuǎn)換器功能
23．2．1ADC命令格式
23．2．3供電傳感器報(bào)警
23．3XADC IP核結(jié)構(gòu)及信號
23．4開發(fā)平臺上XADC接口
23．5在Zynq-7000 SoC內(nèi)構(gòu)建數(shù)?；旌舷到y(tǒng)
23．5．1打開前面的設(shè)計(jì)工程
23．5．2配置PS端口
23．5．3添加并連接XADC IP到設(shè)計(jì)
23．5．4查看地址空間
23．5．5添加設(shè)計(jì)約束文件
23．5．6設(shè)計(jì)處理
23．6使用SDK設(shè)計(jì)和實(shí)現(xiàn)應(yīng)用工程
23．6．1生成新的應(yīng)用工程
23．6．2導(dǎo)入應(yīng)用程序
23．6．3下載硬件比特流文件到FPGA
23．6．4運(yùn)行應(yīng)用工程
第24章Linux開發(fā)環(huán)境的構(gòu)建
24．1構(gòu)建虛擬機(jī)環(huán)境
24．2安裝和啟動Ubuntu14．04客戶機(jī)操作系統(tǒng)
24．2．1新添加兩個磁盤
24．2．2設(shè)置CD/DVD(SATA)
24．2．3安裝Ubuntu14．04
24．2．4更改Ubuntu14．04操作系統(tǒng)啟動設(shè)備
24．2．5啟動Ubuntu14．04操作系統(tǒng)
24．2．6添加搜索鏈接資源
24．3安裝FTP工具
24．3．1Windows操作系統(tǒng)下LeapFTP安裝
24．3．2Ubuntu操作系統(tǒng)環(huán)境下FTP安裝
24．4安裝和啟動SSH和git組件
24．4．1安裝和啟動SSH組件
24．4．2安裝和git組件
24．5安裝交叉編譯器環(huán)境
24．5．1安裝32位支持工具包
24．5．2安裝和設(shè)置SDK 2015．4工具
24．6安裝和配置Qt集成開發(fā)工具
24．6．1Qt集成開發(fā)工具功能
24．6．2構(gòu)建PC平臺Qt環(huán)境
24．6．3構(gòu)建ARM平臺Qt環(huán)境
第25章構(gòu)建Zynq-7000 SoC內(nèi)Ubuntu硬件運(yùn)行環(huán)境
25．1建立新的設(shè)計(jì)工程
25．2添加IP核路徑
25．3構(gòu)建硬件系統(tǒng)
25．3．1添加和配置ZYNQ7 IP
25．3．2添加和配置VDMA IP
25．3．3添加和配置AXI Display Controller IP
25．3．4添加和配置HDMI Transmitter IP核
25．3．5添加和配置VGA IP核
25．3．6連接用戶自定義IP核
25．3．7添加和配置Processor System Reset IP核
25．3．8連接系統(tǒng)剩余部分
25．4添加設(shè)計(jì)約束文件
25．5導(dǎo)出硬件文件
第26章構(gòu)建Zynq-7000 SoC內(nèi)Ubuntu軟件運(yùn)行環(huán)境
26．1u-boot原理及實(shí)現(xiàn)
26．1．1下載u-boot源碼
26．1．2u-boot版文件結(jié)構(gòu)
26．1．3u-boot工作模式
26．1．4u-boot啟動流程
26．1．5編譯u-boot
26．1．6鏈接腳本文件結(jié)構(gòu)
26．2內(nèi)核結(jié)構(gòu)及編譯
26．2．1內(nèi)核結(jié)構(gòu)
26．2．2下載Linux內(nèi)核源碼
26．2．3內(nèi)核版本
26．2．4內(nèi)核系統(tǒng)配置
26．2．5Bootloader啟動過程
26．2．6Linux內(nèi)核啟動過程
26．2．7編譯內(nèi)核
26．3設(shè)備樹原理及實(shí)現(xiàn)
26．3．1設(shè)備樹概述
26．3．2設(shè)備樹數(shù)據(jù)格式
26．3．3設(shè)備樹的編譯
26．4文件系統(tǒng)原理及下載
26．5生成Ubuntu啟動鏡像
26．5．1生成FSBL文件
26．5．2生成BOOT．BIN啟動文件
26．5．3制作SD卡
26．5．4復(fù)制BOOT．BIN文件
26．5．5復(fù)制編譯后的內(nèi)核文件
26．5．6復(fù)制編譯后的設(shè)備樹文件
26．5．7復(fù)制文件系統(tǒng)
26．6啟動Ubuntu操作系統(tǒng)
第27章Linux環(huán)境下簡單字符設(shè)備驅(qū)動程序的開發(fā)
27．1驅(qū)動程序的必要性
27．2Linux操作系統(tǒng)下的設(shè)備文件類型
27．3Linux驅(qū)動的開發(fā)流程
27．4驅(qū)動程序的結(jié)構(gòu)框架
27．4．1加載和卸載驅(qū)動函數(shù)模塊
27．4．2字符設(shè)備中重要的數(shù)據(jù)結(jié)構(gòu)和函數(shù)
27．5編寫Makefile文件
27．6編譯驅(qū)動程序
27．7編寫測試程序
27．8運(yùn)行測試程序
第28章Linux環(huán)境下包含中斷機(jī)制驅(qū)動程序的開發(fā)
28．1設(shè)計(jì)原理
28．2編寫包含中斷處理的驅(qū)動代碼
28．2．1驅(qū)動程序頭文件
28．2．2驅(qū)動的加載和卸載函數(shù)
27．2．3file_operations初始化
28．3編寫Makefile文件
28．4編譯驅(qū)動程序
28．5測試驅(qū)動程序
第29章Linux環(huán)境下圖像處理系統(tǒng)的構(gòu)建
29．1系統(tǒng)整體架構(gòu)和功能
29．2OV5640攝像頭性能
29．2．1攝像頭捕獲模塊的硬件
29．2．2SCCB接口規(guī)范
29．2．3寫攝像頭模組寄存器操作
29．2．4讀攝像頭模組寄存器操作
29．2．5攝像頭初始化流程
29．3Vivado HLS實(shí)現(xiàn)拉普拉斯算子濾波算法的設(shè)計(jì)
29．3．1Vivado HLS工具的性能和優(yōu)勢
29．3．2拉普拉斯算法與HDL之間的映射
29．4圖像處理系統(tǒng)的整體構(gòu)建
29．5圖像處理系統(tǒng)軟件的設(shè)計(jì)
29．5．1Ubuntu桌面系統(tǒng)的構(gòu)建
29．5．2Qt圖像處理程序的開發(fā)
29．6嵌入式圖像處理系統(tǒng)測試